FPGA原型验证
硬件仿真加速器
FPGA代码测评工具
IP/VIP/Transactor
代理EDA工具
设计服务
突破功能验证速度、易用性、性价比等多重瓶颈,提供全流程智能编译、指数级仿真提速、强大调试纠错。
基于四颗Xilinx VU19P FPGA,满足19600万ASIC等效门的设计验证。
基于双颗Xilinx VU19P FPGA,满足9800万ASIC等效门的设计验证。
基于的Xilinx VU19P FPGA,满足4900万ASIC等效门的设计验证。
基于Xilinx Virtex UltraScale XCVU440 FPGA,满足10400万ASIC等效门的设计验证,提供丰富的高性能IO及多种类型高速接口资源。
基于Xilinx Virtex UltraScale XCVU440 FPGA,满足5200万ASIC等效门的设计验证,提供丰富的高性能IO及多种类型高速接口资源。
基于Xilinx Virtex UltraScale XCVU440 FPGA,满足2600万ASIC等效门的设计验证,系统时钟运行频率可达100MHz。
Visual Verification™ Suite 在代码编辑的同时提供实时的代码分析、时钟分析、亚稳态管理等功能,从代码输入阶段便开始提升设计结果质量。
代理销售国内外领先的设计IP/VIP/ Transactor,拥有丰富完善的产品选型库,同时提供高效的个性化定制服务。
加速SoC/ASIC设计验证
混合仿真是指利用硬件仿真加速器和虚拟原型同时运行SoC的不同设计模块,在SoC整体架构形成之前提供嵌入式软件 和硬件的协同仿真,加速SoC研发进程。
图像处理是最直观可视的应用功能实现,FPGA原型验证利用真实的传感设备和输出显示设备提供直观可视的DUT执行结果展现,是最适合图像处理设计的功能验证手段。
从HDL输入到硅后验证,一站式定制化深度服务
从一个设计到多个设计,多维度持续性创造价值
喜报!亚科鸿禹斩获“第十二届中国创新创业大赛 优秀企业”奖
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千兆以太网FPGA原型验证解决方案 —基于亚科鸿禹VeriTiger®系列原型验证平台
数字芯片功能验证方法学理论与实践
全方位全系列产品性能与Demo演示
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